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第二章 浮点数的表达与运算

来源:用户分享 时间:2025/5/31 21:14:35 本文由loading 分享 下载这篇文档手机版
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10、IBM370的短浮点数格式中,总位数为32位,左边第一位(b0)为数符,随后七位(b1~b7)为阶码,用移码表示,偏置常数为64,右边24位(b8~b31)为6为16进制原码小数表示的尾数,采用规格化形式。若将十进制数-260.125用该浮点数格式表示,则应表示为什么?(用十六进制形式表示)

11、IBM370的短浮点数格式中,总位数为32位,左边第一位(b0)为数符,随后七位(b1~b7)为阶码,用移码表示,偏置常数为64,右边24位(b8~b31)为6为16进制原码小数表示的尾数,采用规格化形式。假定一个数表示成该浮点数格式为40100110H(用十六进制形式表示),则该数的真值是多少? 12、把十进制数x=(+128.75)×2-10写成浮点表示的机器数,其中阶码、尾数分别用原码反码和补码表示。设阶码4位,阶符1位,尾数15位,尾数符号1位。

13、设字长32的浮点数,阶码10位用移码表示,尾数22

位用补码表示,基数为2,其格式如下:

1)求最大数的二进制表示;2)求最小数的二进制表示; 3)求规格化的范围

14、有一个字长为32位的浮点数,阶码10位(包括1位阶

符),用移码表示:尾数22位(包括1位尾符)用补码表示,基数r=2。请写出:

1)其所能表达的最大数,用二进制表示; 2)其所能表达的最小数,用二进制表示; 3)规格化数所能表示的数的范围;

4)最接近于零的正规格化数与负规格化数。

15、两规格化浮点数相乘,是否可能需要右规?为什么?是

否可能需要左规?若需要,能否确定左规的次数?

16、两规格化浮点数相乘,是否可能需要左规?为什么?是

否可能需要右规?若需要,能否确定左规的次数?

17、设阶为5位(包括2位阶符),尾数为8位(包括2位数

符),阶码、尾数均用补码表示,完成下列取值的[x+y],[x-y]运算:

1)x=2-011×0.100101,y=2-010×(-0.011110) 2)x=2-101×(-0.010110),y=2-100×0.010110

18、已知两浮点数:A=(-0.010011)×2-010,B=(+0,110111)×2+001.假定阶码和尾数都用补码表示,阶码4位(含1位符号位),尾数7位(含1位符号位)。试按规格化补码加法规则和步骤,采用“0舍1入”法,求[A+B]补=?

19、用浮点数运算步骤对56+5进行二进制运算,浮点数格式为1位符号位、5位阶码位、10位尾码,基数为2。

算术逻辑运算单元ALU

一、选择

1、并行加法器中,每位全和的形式除与本位相加二数数值位有关外,还与 低位数送来的进位 有关

2、ALU作为运算器的核心部件,其属于 组合逻辑电路 3、在串行进位的并行加法器中,影响加法器运算速度的关键因素是 进位传递延迟

4、加法器中每一位的进位生成信号g为 XiYi 5、用8片74181 和两片74182 可组成 二级先行进位结构的32位ALU

6、组成一个运算器需要多个部件,但下面( )不是组成运算器的部件。

A. 状态寄存器 B. 数据总线 C.ALU D. 地址寄存器 7、加法器采用并行进位的目的是 提高加法器运算速度 8、算术/逻辑单元74181可完成16种算术运算功能和16种逻辑运算功能。

9、使用74LS181这种器件来构成一个16位的ALU,需要使用 4 片74LS181。

10、用4片74181和1片74182相配合,具有组内、组间均为并行进位传递功能。

11、用8片74181和2片74182可组成二级先行进位结构的32位ALU。 二、综合应用题

1、一个由4个一位全加器构成的加法器,其进位链小组信号为C4、C3、C2、C1,各全加器的操作数位Ai、Bi(1≤i≥4)低位来的进位信号C0,请分别按下述两种方式写出C1 、C2 、C3和 C4的逻辑表达式。

1) 串行进位方式 2)并行进位方式

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