FPGA 24小时计时器 (5)

4 小结与体会

这一次的课程我的题目是FPGA，拿到这个题目，心中一喜，因为前段时间我就一直在学习FPGA，自己的学习进度是开始学习FPGA中的NIOS II。之前已有初步掌握一些Verilog的应用。本来是觉得可以轻松完成本次FPGA课设，没有想到，实际完成中还是遇到不少困难。

第一天我很顺利地完成了时分秒的显示，但是当加入按键切换到闹钟的时候，出现了问题。编译通过却在板子上实现不了，我开始调整心态，从程序入手，一步步解决问题。终于用了两天的时间完成了实物调试。

但是我之前一直都没有用过modelsim进行仿真，借这次课设的机会，我好好学习了testbench的编写。一开始困难重重，很难仿真出来，modelsim总是报错，我开始沉下心，好好看书，熟悉了仿真规程，慢慢地一个个模块开始仿真。当看到自己各个模块都出现了正确波形，心中十分快乐。接着我加强了理论方面的学习，查阅资料，完成了课程设计报告的撰写。

这次FPGA课程设计，我收获颇多。我的专业知识水平也取得一定的进步。而这些进步都离不开老师和同学的帮助。在此我向曾经帮助和关心我的老师和同学致以诚挚的感谢。

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参考文献

[1] 廖日坤，CPLD/FPGA嵌入式应用开发技术白金手册，中国电力出版社，2003，212-218。

[2] 高吉祥，电子技术基础实验与课程设计，电子工业出版社，2002。 [3] 赵保经，中国集成电路大全，国防工业出版社,1985。

[4] 王开军,姜宇柏，面向CPLD/FPGA的VHDL设计,机械工业出版社,2006，28-65。

[5] 吕思忠，数子电路实验与课程设计，哈尔滨工业大学出版社，2001。 [6] 王金明.数字系统设计与verilog HDL.北京电子工业出版社.2008

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本科生课程设计成绩评定表

姓 名 专业、班级 题 目： 答辩或质疑记录： 性 别 成绩评定依据： 序号 1 2 3 4 5 内容 态度认真、学习刻苦、遵守纪律 实验方法正确，仪器使用得当，测试结果正确 电路原理及实验结果分析正确 设计报告的规范化、参考文献充分 课程设计答辩 分值 20 25 25 10 20 得分 最终评定成绩（以优、良、中、及格、不及格评定）

指导教师签字：

年 月 日

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